Diskussion zu: Hardware- und Nachrichten-Links des 8. Juni 2016

[Leonidas]

Link zur News:
http://www.3dcenter.org/news/hardware-und-nachrichten-links-des-8-juni-2016

[Dr.Doom]

Bei der Pascal-Generation ist das Fertigungsgrößen-Limit (bei grob 650-700mm²) relativ gesehen deutlich weiter entfernt und nVidia wäre somit in der Lage, den GP102-Chip mit einer höheren Mehrperformance auszurüsten als in der Pascal-Generation gesehen.
-Pascal
+Maxwell

[Complicated]

Bei der Pascal-Generation ist das Fertigungsgrößen-Limit (bei grob 650-700mm²) relativ gesehen deutlich weiter entfernt und nVidia wäre somit in der Lage, den GP102-Chip mit einer höheren Mehrperformance auszurüsten als in der Pascal-Generation gesehen.
Hier wäre es doch mal interessant genau aufzuschlüsseln, warum das Fertigungslimit aus 28nm nach wie vor Gültigkeit haben soll bei 16nm. Der Kostensprung bei 16nm kann teilweise durchaus Aufgrund der höheren Fehlerrate pro mm², weil schließlich auch mehr Transistoren verbaut werden die defekt sein können,. Eventuell ist bei 14/16nm schon bei 450-500 mm² die Quote so hoch, dass man keinen Chip mehr ohne deaktivierte Einheiten gefertigt bekommt, weil man sonst zu viele Redundanzen in der Fläche benötigt. Das sähe dann schlecht aus für einen 600mm² Vollausbau.

Das würde auch AMDs Zug beim Transit zu Navi auf Interposer mit kleineren Dies zu setzen erklären, vor allem wenn das Problem sich bei 10nm noch weiter verstärkt. Hier würde die Grenze dann bei der Wirtschaftlichkeit liegen und nicht an den technischen Möglichkeiten der Lithografie. Hier sind die SoC-Hersteller deutlich weniger betroffen.

Nimmt man diese Grafik als Basis:
http://i.imgur.com/eezbRGE.jpg

So wird schnell klar, dass ein Hersteller dagegen wirken kann indem er die Yields verbessert. Das kann man indem man kleinere Chips baut. Nvidia hat bei GP100 eine geringere Packdichte gewählt um die Kosten/Yields zu verbessern für die gewählten Taktraten.

[Gast]

Was genau spricht eigentlich gegen HBM bei GP102?

[greeny]

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